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邏輯設計工程師

工作地點: 上海 深圳 武漢 橫琴 蘇州

職責描述:

負責PCIE Retimer/PCIE Switch近司以及DPU上的網絡和存儲卸載方案的行長設計與實現 職責要求(滿足至少一項):-精通Verilog/SystemVerilog語言,熟悉TCL/哥的Python/Shell其中一種(z坐人hǒng)腳本語言; -熟悉TCP/業山IP協議和常見的報文轉發(fā)流程; -熟悉P長話CIE協議以及鏈路訓練協商的工作原理; -熟悉Firewall舞東/eBPF等工作原理; -熟悉ToE/RDMA等存請快儲卸載方案; -熟悉GZIP/LZ4/ZLI兒煙B等壓縮解壓縮算法; -熟悉各種(zhǒng)加物山解密算法; -熟悉CPU虛拟化和Virtio協議; 友著-熟悉NVME,ext4/xfs/btrfs等常見文件系統存儲原理;我街 -熟悉常用的硬件接口:Et國家hernet Mac模塊,DDR控制器,PCIE冷道/DMA接口; -了解基于SystemVerilog的UVM驗證方法; 具有以下經(jīng)驗者均優先考慮:-熟悉NVMe over fabric等網絡協畫資議; -熟悉Linux Kernel Block層及EXT兒筆*/XFS/BTRFS等常見文件系統存儲原理; -熟悉典型的分布式塊存用站儲的實現方案; -熟悉可信計算的基本概歌讀念和要求;